捆绑调整计算架构的计算方法、装置和电子设备

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捆绑调整计算架构的计算方法、装置和电子设备
申请号:CN202410847157
申请日期:2024-06-27
公开号:CN118819833A
公开日期:2024-10-22
类型:发明专利
摘要
本申请涉及捆绑调整优化技术领域,特别涉及一种捆绑调整计算架构的计算方法、装置和电子设备,其中,方法包括:获取多个GTG计算序列和多个FTF计算序列;将每个GTG计算序列划分为多个第一子任务,并将每个FTF计算序列划分为多个第二子任务;基于所有第一子任务的优先级和所有第二子任务的优先级,动态分配每个GTG计算序列对应的多个第一子任务和每个FTF计算序列对应的多个第二子任务至多个矩阵乘模块,并基于分配结果,利用FPGA加速器进行捆绑调整优化计算。由此,解决了目前的BA优化加速器方案存在资源利用效率低、开销大的问题,在面向资源受限的小型无人系统,通过设计高效BA优化加速器,能适应不同任务场景。
技术关键词
加速器 序列 视觉传感器 现场可编程门阵列 计算方法 可执行程序代码 通信模块 面向资源受限 矩阵 小型无人 电子设备 计算机程序产品 算法 处理器 可读存储介质 存储器 数据