一种GPGPU指令执行阶段的并行优化方法和系统

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一种GPGPU指令执行阶段的并行优化方法和系统
申请号:CN202510240366
申请日期:2025-03-03
公开号:CN120315760A
公开日期:2025-07-15
类型:发明专利
摘要
本发明提供一种GPGPU指令执行阶段的并行优化方法和系统,其中方法包括基于指令类型、操作数依赖性分析及硬件资源实时状态,将输入的指令拆分为多个可独立调度的子指令,生成依赖关系表以记录子指令的输入输出关联;采集计算单元、存储单元以及通信单元的实时负载数据,采用优先级动态调整算法并结合指令关键路径分析,将子指令分配至计算单元、存储单元或通信单元;根据子指令的依赖关系和硬件资源可用性,调整子指令的执行顺序以最大化并行度;实时解析子指令间的依赖关系,以最大化并行度动态调整并行执行策略,以实现依赖指令的串行执行及无依赖指令的并行执行。本发明降低编译指令的复杂度,提高编译指令的效率,同时降低了额外耗时。
技术关键词
并行优化方法 通信单元 卷积神经网络模型 存储单元 分配单元 数据传输需求 阶段 关系 分支指令 渲染单元 副本 指令执行单元 标识符 动态 哈希表 算法 模块 流水线
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